逻辑操作与容错协议state
逻辑态制备
通过编码器、稳定子投影、测量或 teleportation 准备 |0_L>, |+_L> 与任意逻辑态。
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01
范围与辨析
本主题覆盖把系统制备到指定编码态或逻辑子空间的协议，包括编码线路、稳定子投影和 teleportation-based preparation。物理 reset、通用 encoder 综合和 magic-state distillation 分别独立处理。
02
核心机制与研究判断
核心机制
- unitary encoding
- measurement-based preparation
- stabilizer projection
- verified ancilla
- magic-state injection interface
适用场景
- 用于量子存储、逻辑 benchmark 或 fault-tolerant gadget 的受保护输入态制备。
比较维度
- 比较逻辑态保真度、可检测/不可检测故障、接受率、深度、ancilla 和后续 EC 开销。
至少报告
- 声明目标逻辑态、制备线路、验证或 post-selection 规则、噪声位置和成功条件。
重点风险
- 只验证 stabilizer syndrome 为零不能排除逻辑错误；post-selection 结果还必须报告接受率。
03
全栈位置与直接关系
logical/state/logical-prep← flow物理初始化与 reset准备 |0>, |+> 或平台特定基态，并管理热激发、泄漏与重复使用辅助比特。→ flow编码线路综合将码的生成矩阵、稳定子或逻辑基态转换为门序列，并满足硬件连接。→ 依赖容错逻辑操作纠错循环必须与逻辑门、测量、注入和码切换共同设计。← pathShor [[9,1,3]]九量子比特距离-3稳定子码；将相位翻转重复码与比特翻转重复码级联，适合完整演示从连续错误到离散 syndrome 的纠错过程。→ path编码线路综合将码的生成矩阵、稳定子或逻辑基态转换为门序列，并满足硬件连接。→ 扩展逻辑态注入把裸态或弱编码资源态通过 syndrome 投影、teleportation 或边界协议转移到受保护逻辑码空间，通常为非 Clifford 门提供输入。
04
代表证据
当前主题尚未关联可展示的代表论文。